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Cadence SPB使用经验总结

作者:高考题库网
来源:https://www.bjmy2z.cn/gaokao
2021-02-27 15:34
tags:

-

2021年2月27日发(作者:installs)


Cadence SPB


使用方法



1.



在用


OrCad


Capture < /p>


CIS


画电路原理图时,不同电路图页面之间的信号互联,


单信号线


(wire)


用分页端口连接器(< /p>


Off Page Connector


)实现互联,总线



Bus



用端



(Port)




互连




可 以



分页



口 连



器(


Off


Page


Connector






2.



特别注意:


FPGA


原理图设计中,


在为< /p>


FPGA


设计原理图符号时,


一般要将< /p>


FPGA


分为多个部分,


这时一定要注意 在管脚功能划分时,


要将


Bank2


中 用于配置的


管脚,


包括:


配置模式选择 管脚


M0



M1,CCLK,DIN, INIT_B


等与


TMS,TCK,TDO,TDI

< p>
等一起划分到


FPGA


的配置(

< br>Configuration


)部分。



3.




OrCad


Capture


CIS


中制作原理图符号时,如果器件有多个(两个以上)管


脚名称(


pin name


)相同,在保存该元件时就会弹出以下警告信息:




因为


ORCAD

的封装


(原理图符号)


是有规则的,


只有管脚为


POWER


属性才能同


名 ,


比如


VCC,GND


的管脚名等等,


很好理解,


这些属性在画


PCB


的时候默认的是同


一个网络,


是要连接在一起 的,



GND



GND



VCC


< br>VCC



有时候有很多的空脚


N C


最好用


NC1,NC2...


来描述 ,避免不必要的错误,有的甚至连


POWER


属性的管脚名


都不做重复的。如果忽略这些这些警告信息,则当使用这些元件符号画电路图,


在生成网表(


Create Netlist


)时就会产生错误:



#79 Error




[ALG0050] Duplicate Pin Name


Number 9: SCHEMATIC1, POWER SUPLLY (1.80, 3.20). Please renumber one of these.


这时选中设计,可以利用


accessories


菜 单的


libcorrectionutil->library


verification / correction


来批量 修改重复管脚定义(即:批量把重复的管脚


名改为不同)。(


a ccessories->libcorrectionutil->library


verification


/


co rrection


)但是通过这种方法只能修改元件库


Libr ary


中的元件,不能更新到


原理图页面中。

< br>



如图所示,选中


Duplicate Pin Names


复选框。




当然也可以手动把重复管脚名称改过来,即加数字编号:


1

< br>,


2



3


??。或


者把重复管脚名称管脚的属性改为


POWER,


因为


CIS


里面只允许

POWER


属性的管脚


同名。



出现这个问题,另外一个可能的原因是因为制作元件时


Part name



Part


number


混了。



于其后期出现了问题再修改,


就不如在最初设计原理图符号时就把问题解决


了,即:要把


Pin


Name

< p>
改成互不相同,如加上


0,1,2,3...


的编 號,例如:


NC1



NC2

< p>


NC3


??,等,还有


Pin Number


不可为空或者为


0




总之,


allegro



netlist


不能有相同的管脚名


,


除了


power


类型 的管脚。


在做零件的過程,可以先將


vcc


vss


設成


power pin


,這樣了,既使都叫


vcc


也不會有問 題。但是如果是


I/O,


建議你乖乖的給它名字,要不然它可 是不會讓


你轉


net lists


的。



#79 Error




[ALG0050] Duplicate Pin Name


Number 9: SCHEMATIC1, POWER SUPLLY (1.80, 3.20). Please renumber one of these.



这个意思 是说


,


你的原理图


VDD

< p>
有重复的名字


,


处理方法点上这个


U21,


点右



.

< p>
出现


EDIT


PART

,



VDD


有些重复的改成


VDD1,VDD2,


还有些


GND


改成


GND1


.



这样操作了是更新了图上的器件的引脚,怎么给它更新到库里 呢?



编辑完成后,


关闭对话框,


会弹出信息问你要不要更新。


你可以选择更新当

前或所有同样的封装。




要想 保存到库里去


,


防止以后现有这样的事发生

:


1


你编辑好以后关悼对话框


,


你先更新所有的吧;



2


编辑好之后


.


到原理图看下图操作。



如果你要更新你库文件里的,


可以在


DESIGN


Cache


里面复制你更新的 封装,


粘贴到你的库文件复盖你的原封装就行了。


< p>
每个


Part



Pin Name


是不可以重复的,你要修改一下的。只有当他们的


Ty pe



Power


时才可以重复。



如果在前期原理图符号设计中忽略了重复管脚的问题,

< p>
在出现错误时,


在原


理图中修改错误的最简捷的处 理方法如下例所示:



#1 Error




[ALG0050] Duplicate Pin Name


2


Pin


Number


7:


SCHEMATIC1,


POWER


SUPLLY


(6.60,


4.00).


Please renumber


one


of


these.


错误信息提示,


U22 Pin Number 7



Duplicate Pin Name


,则在相应的原理图


页面找到该元件


U22

< p>
,选中它。




单击鼠标右键,在弹出菜单中选择


Edit Part





打开元件编辑页面,



按住

< p>
Ctrl


键选中所有重复名称的管脚(


Dupli cate


Pin


Name


),点击右键选择


Edit Properties,





弹出管脚属性编辑窗口:




给其中的重复管脚重新命名,编号。




单击


OK


按钮关闭,关闭


Part Edit


窗口:




在弹出的


Save Part Instance


提示窗口中,选择


Update All,



其余两个提示都选


YES,


更新全部,则在原理图中的所有元件都得到更新。




4.



Orcad Capture CIS


中原理图符号的管脚编号(


Pin Number


而不是管脚名称


Pin Name


)与


Allegro PCB Design


中的


PCB


封装管脚相对应。例如:

< p>




-


-


-


-


-


-


-


-



本文更新与2021-02-27 15:34,由作者提供,不代表本网站立场,转载请注明出处:https://www.bjmy2z.cn/gaokao/674595.html

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